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静电放电敏感度测试ANSI/ESD STM5.1—2001(3-2)

文章来源:SMTedit     发布时间:2009-9-18 9:21:00     发布时间:2009-9-18 9:21:00  【关闭】

7.鉴定和验证程序

7.1 HBM ESD测试器和测试固定板鉴定程序

HBM ESD测试器鉴定,必须确保峰值短路电流(1ps)波形的完整性,如图2a,2b和3中所示。
对于最初鉴定,在测试固定板上的每个插座都要进行。

对于测试器的再鉴定,它仅需使用最高插脚数据的事宜 一个肯定夹紧插座的测试固定板。全部其他的肯定夹紧测试固定板,当它们在使用时,将按第8.1.2节检查。

7.1.1 核对测试固定插脚的电气连接.

7.1.2新测试因定板的鉴定

7.1.2.1 对每个插座,识别出插座插脚到达脉冲发生电路的最短配线路径,把这个插脚连接到终端B.依次连接每个插座的另一个插脚到终端A.使用短路线,加上±1000伏特脉冲.全部波形参数应不超出图2a和图3所规定的极限.

7.1.3 现有测试固定板的鉴定.

7.1.3.1 为每个在测试因定板上的测试插座规定相关的插脚对,识别出从脉冲发生器电路到测试插座具有最短配线路径的插座插脚,连接这个插脚到终端B.识别出从脉冲发生器电路到ESD 压力插座具有长配线路径的插脚,连接这个插脚到终端A.作为选择此相关的插脚对,可能在以前机器模型(MM)测试的暑假被确定过.(参见 ESD-S5.2)

7.1.3.2在相关的插脚对之间加短路线,连接终端A和终端B.把电流传感器围绕短路线放置,实际中接近终端B,注意在图1中的极性显示.

I 对肯定夹紧插座,插入短路线,在插座插脚之间连接A和B.

II 对非肯定夹紧插座,加短路线到测试固定件的插座插脚之间连接终端A和B.此连接点将尽可能接近测试插座插脚.

7.1.3.3应用5正和5负的脉冲.在1000伏特、2000伏特和4000伏特观察波形。校验波形的全部参数是否符合图2a的规定。

7.1.3.4以500欧姆电阻代替短路线。电阻末端的导线将穿过电流传感器连接到B,注意显示在图1中的极性。

7.1.3.5在1000和4000伏特观察正和负的波形。校验小型的全部参数是否符合图3的规定。

7.1.3.6将示波器的水平时间标度设定为每区分1毫秒。使用短路线,启动任何寄生脉冲小于主脉冲振幅15%的脉冲和校验。

7.2波形验证程序

使用下列程序校验波形.

7.2.1核对测试插座固定板上所有插脚的电气连接.

7.2.2在相关的插脚对之间辊上短路线.把电流传感器围绕短路线放置,实际中接近终端B,注意图1中的极性显示.

7.2.3使用短路线,在1000和4000伏特(或者对要测试的压力级别)校验正和负两者的波形.如果测试必须在4000V以上运行,即在8000V,校验波形.校验波形的全部参数应符合图2a的规定.

7.2.4将示波器的水平时间标度设定为每区分1毫米.启动任何寄生脉冲小于主脉冲振幅15%的脉冲和校验.

7.3维护之后的波形验证

测试器在任何的修理和维护之后按制造者推荐和第7.1节,校验波形的全部参数应符合图2a规定.

8.ESDS 测试要求和程序

8.1测试要求

8.1.1元件的装卸.在测试之前、之吕和之后装卸元件的暑假,ESD损害防护程序。

8.1.2 必需的波形检查。校验波形完整性(在第7.2节描述),使用短路线在±1000伏特或按电压级别测试.对规定的相关插脚对,按第7.1.3节所指示,进行波形的完整性检查。

对肯定夹紧插座,在测试固定板每次变更时,此项波形检查是必需的. 对所有其他类型的插座,此项波形检查推荐进行.

如果必须移动测试固定板和置换一个带肯定夹紧插座的测试固定板,来帮助波形测量,至少对每一次变动都要校验波形.如果对几次连续的检查,观察到波形没有改变,可以在波形检查之间使用较长的周期。然而,如果在全部ESD电压 测试之后,波形不再符合规定的界限,应考虑前面满意的波形检查是无效的.

如果ESD电压测试运行在连续的转换中,波形检查在一次转换结束时,也可作为是以下转换的初始检查.

8.1.3高电压放电路径检查.在每天开始ESD电压测试时,使用测试器制造者推荐的程序,测试高电压放电路径和全部关联电路。如果发现任何故障,不再使用损坏的带有插座的放电路径进行测试.修理测试器,然后按第7.3节重新取得资格.

8.1.4元件静态和动态测试.在ESD测试之前和之后,进行元件的全部静态和动态参数数据测试,以确定元件是否已经损坏.在测定元件ESD耐压的时候,插脚泄漏电流可能是唯一的指示.但以插脚泄漏作为元件失效的唯一标准是不充分的,尤其是对于复杂的集成电路.

8.1.5插脚组合.

使用于全部集成电路ESD耐压测试的插脚组合,给出定在表2和第8.1.5.1节中.

插脚组合(n)是插脚组合的总数.这个从元件到无件的改变,取决于同样名称电源插脚编号的集合.表2中的Vps(i)是任何同样名称的电源或接地插脚组(例如Vcc、Vss、Bdd、模拟地、数字式地等等),在芯片上或在管壳内部是金属连接的(小于2欧姆)。经芯片片基、或电位阱、或相互电气绝缘的同样名称插脚之间有阻抗连接(超过2欧姆),为了测试被除数认为是分开的组。(也就是说,如果二个插脚的标记是Vcc,但却不是金属的小于2欧姆的芯片或管壳内部连接,他们将看作是明显分开的Vps(I)组。)

仅仅提供电流到界面、或到其他插脚的那些插脚将被认为是电源插脚。如Vcc、Vdd、地、Vss、Vee、±Vs和-Vs被认为是电源供给插脚。这些插脚通过其他插脚周围接近的界面这一路径提供电流给输入和输出缓冲。

如偏移调整、校正、时钟、控制、地址、数据、Vref|、未连接(NC)、输出和输入这样的插脚,被认为是非电源供给插脚。举例来说,一个编程电源插,通常叫做Vpp,将被认为是一个非电源供给插脚,因为它不对任何其他插脚的界面提供电流,也不是任何非电源插脚的两极管降压叫源。

对插脚组合进一步的澄清,见附录A中的例子。为了ESD耐压测试,用于全部有源和无源分立元件和元件阵列的插脚组合,给定在第8.1.5节中。

8.1.5.1 对于全部分立元件和元件阵列的插脚组合包括无源的和有源的元件).全部可能的插脚对组合(一个插脚到终端A,另一个到终端B)不考虑插脚的功能.

8.2HBM 分级和ESD压力测试程序

元件依照他们的HBM ESD耐压分类.按照下面的程序在ESD压力测试.允许使用表3中任何的电压级别作为开始的电压级别.如果需要,三个新的元件可以使用各自的电压水平或插脚组合。这将排除任何步进压力使之变强的效果,和减少由于在电源插脚上累积的电压造成早期失效的可能性。然而,如果是一个强调各自压力级别的三个元件的单一组合,那么要避免可能的ESD脆弱窗口伤害,推荐不要错过任何的压力步进方式.

ESD分级测试被认为对元件是破坏性的,即使不发生元件失效.

表2 全部数字、模拟和混合集成电路的插脚组合

插脚组合

个别地连接到终端A

连接到终端B

不固定的插脚
(不连接)

1

每次全部插脚,连接到终端B的插脚除外

Vps(1)
[第一电源插脚]

全部插脚,在测试中的插脚(PUT)和Vps(1)
[第一电源插脚]除外

2

每次全部插脚,连接到终端B的插脚除外

Vps(2)
[第二电源插脚

全部插脚, PUT和Vps(2)
[第二电源插脚]除外

i

每次全部插脚,连接到终端B的插脚除外

Vps(i)
[第i电源插脚
[1,2,……I]

全部插脚,PUT和Vps(i)除外

n-1

每次全部插脚,连接到终端B的插脚除外

Vps(n-1)

全部插脚, PUT和Vps(n-1)除外

n

每次全部非Vps(i)插脚

全部其他非Vps(i)插脚,连接到终端A的插脚除外
[第一电源插脚

全部Vps(i)插脚

表3 HBM ESD 压力级别

压力级别

等值充电(±)电压
Vp(伏特)


1

250

2

500

3

1000

4

2000

5

40000

6

8000(任意的)

注2:一个元件可能在4000V通过从早到晚 在2000V失效,这叫做一扇元件失效窗口。为了避免这个失效窗口,推荐元件按表3中的规定,在各自的分类级别测试。

使用下列程序对元件分类:

8.2.2 测试最少有三个全部指定静态和动态参数数据的元件样品。8.2.2从表3确定开始加压的电压级别。按第8.1.5节所述选择第一个插脚组合测试。

8.2.3 加一个正的和一个负的脉冲到元件。在脉管炎冲之间允许最小为0.3秒的间隔。按第8.1.5节所述,对所有其他的插脚组合重复这一过程。

注3:每极性一个脉冲是对以前5.1HBM 标准(1991、1993)的一项重要改变,以前是每极性三个脉冲。

8.2.4 对每个元件测试全部静态和动态参数数据并记录各自的结果。参数和功能测试必须在室温进行。如果需要在多温度下测试,应首先在最低的温度进行。

如果三个元件全部通过规定的参数数据,重复第8.2.3节的步骤直到第8.2.4节,使用表3中下一个更高的压力级别。如果需要,三个新的元件可以使用各自的电压级别或插脚组合。

8.2.5 如果一个或更多的元件失效,使用三个新的元件,在一个较低的压力级别开始,重做ESD压力测试。如果此元件继续失效,减少压力电压直至表3中的级别1。如果在级别1观察到任何其他的失效,在这个级别停止全部测试。

 

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